ファイル:NOR gate layout.png

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NOR_gate_layout.png(600 × 433 ピクセル、ファイルサイズ: 22キロバイト、MIME タイプ: image/png)

概要

解説

Shows a CMOS implementation of a NOR gate.

Also used at http://www.sccs.swarthmore.edu/users/06/adem/engin/e77vlsi/lab3/
日付 2009年11月20日 (当初のアップロード日)
原典 コンピュータが読み取れる情報は提供されていませんが、投稿者自身による著作物だと推定されます(著作権の主張に基づく)
作者 コンピュータが読み取れる情報は提供されていませんが、Miquel puigだと推定されます(著作権の主張に基づく)

ライセンス

Public domain この著作物の著作権者である私は、この著作物における権利を放棄しパブリックドメインとします。これは全世界で適用されます。
一部の国では、これが法的に可能ではない場合があります。その場合は、次のように宣言します。
私は、あらゆる人に対して、法により必要とされている条件を除き、如何なる条件も課すことなく、あらゆる目的のためにこの著作物を使用する権利を与えます。

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題材

20 11 2009

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現在の版2009年11月20日 (金) 12:412009年11月20日 (金) 12:41時点における版のサムネイル600 × 433 (22キロバイト)Miquel puig== Summary == Shows a CMOS implementation of a NOR gate. Also used at http://www.sccs.swarthmore.edu/users/06/adem/engin/e77vlsi/lab3/ == Licensing == {{PD-self|date=November 2007}} Category:Logic Category:Logic gates

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